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Dettagli del prodotto
Inchiesta
MCIMX6S1AVM08AC NXP

• Il i.MX 6Solo supporta Cortex-A9 MPCore a braccio singolo (con TrustZone)
• Il i.MX 6DualLite supporta il doppio Arm Cortex-A9 MPCore (con TrustZone)
• La configurazione del nucleo è simmetrica, dove ogni nucleo include:
— 32 KByte L1 Cache delle istruzioni
— 32 KByte L1 Cache dati
— Timer privato e cane da guardia
— Coprocessore Cortex-A9 NEON MPE (Media Processing Engine)
• General Interrupt Controller (GIC) con supporto per 128 interrupt
• Timer globale
• Unità di controllo Snoop (SCU)
• Cache I/D L2 unificata da 512 KB:
— Utilizzato da un core in i.MX 6Solo
— Condiviso da due core in i.MX 6DualLite
• Due interfacce bus Master AXI in uscita dalla cache L2
• Frequenza del core (inclusa la cache NEON e L1), come da Tabella 8.
• Coprocessore NEON MPE
— Architettura di elaborazione multimediale SIMD
— File di registro NEON con registri generici a 32x64 bit
— Pipeline di esecuzione di numeri interi NEON (ALU, Shift, MAC)
— Pipeline di esecuzione in virgola mobile NEON doppia a precisione singola (FADD, FMUL)
— Tubazione di caricamento/archiviazione e permutazione NEON
 
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Il messaggio è ObbligatorioIl messaggio deve essere compreso tra 20 e 2000 caratteri

Suggerimenti su come ottenere preventivi accurati dai fornitori. Per favore includere il Di seguito nella tua richiesta:
1. Informazioni personali o aziendali
2. Fornire la richiesta di prodotto in modo molto dettagliato
3. Richiesta di MOQ, prezzo unitario, ecc


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