SAK-TC213L-8F133N AC INFINEON
Disponibile
SAK-TC213L-8F133N AC INFINEON
La famiglia di prodotti TC22x / TC21x ha le seguenti caratteristiche:
• Microcontrollore ad alte prestazioni con un core CPU
• CPU TriCore scalare Power Efficient (TC1.6E), avente le seguenti caratteristiche:
– Compatibilità del codice binario con TC1.6P
– Funzionamento a 133 MHz a pieno intervallo di temperatura
– 88 Kbyte di RAM per scratch-pad dati (DSPR)
– 8 Kbyte di istruzioni Scratch-Pad RAM (PSPR)
– Cache delle istruzioni da 8 Kbyte (ICACHE)
– Buffer di lettura a 4 linee (DRB)
• Nucleo d'ombra a gradini bloccati per TC1.6E
• Memorie multiple su chip
– Tutti gli NVM e SRAM integrati sono protetti ECC
– Memoria flash di programma da 1 Mbyte (PFLASH)
– Memoria flash dati (DFLASH) da 96 Kbyte utilizzabile per l'emulazione EEPROM
– BootROM (BROM)
• Controller DMA a 16 canali con trasferimento dati sicuro
• Sofisticato sistema di interrupt (protetto ECC)
• Struttura bus on-chip ad alte prestazioni
– SRI (Cross Bar Interconnect) a 64 bit che offre un rapido accesso parallelo tra bus master, CPU e memorie
– SPB (System Peripheral Bus) a 32 bit per periferiche e unità funzionali su chip
– Un ponte bus (SFI Bridge)
• Unità di gestione della sicurezza (SMU) che gestisce gli allarmi del monitor di sicurezza
• Unità di test della memoria con funzioni ECC, inizializzazione della memoria e MBIST (MTU)
• Hardware I/O Monitor (IOM) per il controllo di I/O digitali
• Unità periferiche su chip versatili
– Due canali seriali asincroni/sincroni (ASCLIN) con supporto hardware LIN (V1.3, V2.0, V2.1 e J2602) fino a 50 MBaud
– Quattro canali di interfaccia SPI in coda (QSPI) con capacità master e slave fino a 50 Mbit/s
– Un modulo MultiCAN+ con 3 nodi CAN ciascuno e 128 oggetti messaggio assegnabili gratuitamente per una gestione dei dati ad alta efficienza tramite buffering FIFO e trasferimento dati gateway
– 4 canali Single Edge Nibble Transmission (SENT) per il collegamento ai sensori
– Un modulo timer generico (GTM) che fornisce un potente set di funzionalità di filtraggio del segnale digitale e timer per realizzare una gestione autonoma e complessa di ingressi/uscite
– Un modulo Capture / Compare 6 (due kernel CCU60 e CCU61)
– Un'unità timer 12 per uso generale (GPT120)
• ADC versatile ad approssimazione successiva (VADC)
– Cluster di 2 kernel ADC indipendenti
– Intervallo di tensione di ingresso da 0 V a 5,5 V (alimentazione ADC)
• Porte I/O digitali programmabili
• Supporto di debug on-chip per OCDS Level 1 (CPU, DMA, bus su chip)
• Interfaccia JTAG (IEEE 1149.1) o DAP (Device Access Port) a quattro/cinque fili
• Sistema di gestione dell'alimentazione e regolatori on-chip
• Unità di generazione clock con PLL di sistema
• Regolatore di tensione incorporato
La famiglia di prodotti TC22x / TC21x ha le seguenti caratteristiche:
• Microcontrollore ad alte prestazioni con un core CPU
• CPU TriCore scalare Power Efficient (TC1.6E), avente le seguenti caratteristiche:
– Compatibilità del codice binario con TC1.6P
– Funzionamento a 133 MHz a pieno intervallo di temperatura
– 88 Kbyte di RAM per scratch-pad dati (DSPR)
– 8 Kbyte di istruzioni Scratch-Pad RAM (PSPR)
– Cache delle istruzioni da 8 Kbyte (ICACHE)
– Buffer di lettura a 4 linee (DRB)
• Nucleo d'ombra a gradini bloccati per TC1.6E
• Memorie multiple su chip
– Tutti gli NVM e SRAM integrati sono protetti ECC
– Memoria flash di programma da 1 Mbyte (PFLASH)
– Memoria flash dati (DFLASH) da 96 Kbyte utilizzabile per l'emulazione EEPROM
– BootROM (BROM)
• Controller DMA a 16 canali con trasferimento dati sicuro
• Sofisticato sistema di interrupt (protetto ECC)
• Struttura bus on-chip ad alte prestazioni
– SRI (Cross Bar Interconnect) a 64 bit che offre un rapido accesso parallelo tra bus master, CPU e memorie
– SPB (System Peripheral Bus) a 32 bit per periferiche e unità funzionali su chip
– Un ponte bus (SFI Bridge)
• Unità di gestione della sicurezza (SMU) che gestisce gli allarmi del monitor di sicurezza
• Unità di test della memoria con funzioni ECC, inizializzazione della memoria e MBIST (MTU)
• Hardware I/O Monitor (IOM) per il controllo di I/O digitali
• Unità periferiche su chip versatili
– Due canali seriali asincroni/sincroni (ASCLIN) con supporto hardware LIN (V1.3, V2.0, V2.1 e J2602) fino a 50 MBaud
– Quattro canali di interfaccia SPI in coda (QSPI) con capacità master e slave fino a 50 Mbit/s
– Un modulo MultiCAN+ con 3 nodi CAN ciascuno e 128 oggetti messaggio assegnabili gratuitamente per una gestione dei dati ad alta efficienza tramite buffering FIFO e trasferimento dati gateway
– 4 canali Single Edge Nibble Transmission (SENT) per il collegamento ai sensori
– Un modulo timer generico (GTM) che fornisce un potente set di funzionalità di filtraggio del segnale digitale e timer per realizzare una gestione autonoma e complessa di ingressi/uscite
– Un modulo Capture / Compare 6 (due kernel CCU60 e CCU61)
– Un'unità timer 12 per uso generale (GPT120)
• ADC versatile ad approssimazione successiva (VADC)
– Cluster di 2 kernel ADC indipendenti
– Intervallo di tensione di ingresso da 0 V a 5,5 V (alimentazione ADC)
• Porte I/O digitali programmabili
• Supporto di debug on-chip per OCDS Level 1 (CPU, DMA, bus su chip)
• Interfaccia JTAG (IEEE 1149.1) o DAP (Device Access Port) a quattro/cinque fili
• Sistema di gestione dell'alimentazione e regolatori on-chip
• Unità di generazione clock con PLL di sistema
• Regolatore di tensione incorporato
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